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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA 的嵌入式ASIP 軟核設(shè)計與實現(xiàn)

      基于FPGA 的嵌入式ASIP 軟核設(shè)計與實現(xiàn)

      2010-02-06 | rar | 442 | 次下載 | 5積分

      資料介紹

      基于FPGA 的嵌入式ASIP 軟核設(shè)計與實現(xiàn)
      作者:李慶誠 任健 劉嘉欣 黃寶貞 來源:微計算機信息
      摘要：采用ASIP+FPGA 模式設(shè)計了一款嵌入式微處理器軟核，以該軟核為例從體系結(jié)構(gòu)和指令集設(shè)計兩方面對ASIP+FPGA 模式微處理器軟核的設(shè)計進行了分析和驗證，最后通過與傳統(tǒng)微處理器對比驗證了該設(shè)計模式的優(yōu)勢：指令針對性強，執(zhí)行效率高；易于擴展，適應(yīng)性強。
      關(guān)鍵詞：嵌入式系統(tǒng)，處理器軟核，ASIP，F(xiàn)PGA，VHDL
      嵌入式系統(tǒng)往往執(zhí)行比較單一的任務(wù)，針對某種特定應(yīng)用而專門設(shè)計，但目前在嵌入式系統(tǒng)中采用的微處理器絕大部分都是通用嵌入式微處理器，其通用的指令集面對千差萬別的嵌入式應(yīng)用時暴露出專用性差，執(zhí)行效率低的弱點。另一個問題是，目前應(yīng)用的嵌入式微處理器都是硬核，功能模塊和指令集都是固定的，當應(yīng)用發(fā)生較大變化時，很難通過對微處理器功能模塊和指令集進行擴展來適應(yīng)變化，往往只能換用一款新的微處理器，甚至重新設(shè)計整個嵌入式系統(tǒng)的硬件和軟件，浪費了大量的時間和金錢。因此，如何提高指令集的針對性，提高指令的執(zhí)行效率以及如何增強嵌入式微處理器的擴展能力成了困擾嵌入式系統(tǒng)開發(fā)人員的兩個難題。
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